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模拟信号在时域上是连续的,因此可以将它转换为时间上连续的一系列数字信号。这样就要求定义一个参数来表示新的数字信号采样自模拟信号速率。这个速率称为转换器的采样率(samplingrate)或采样频率(samplingfrequency) [2] 。
可以采集连续变化、带宽受限的信号(即每隔一时间测量并存储一个信号值),然后可以通过插值将转换后的离散信号还原为原始信号。这一过程的精确度受量化误差的限制。然而,仅当采样率比信号频率的两倍还高的情况下才可能达到对原始信号的忠实还原,这一规律在采样定理有所体现 [2] 。
由于实际使用的模拟数字转换器不能进行*实时的转换,所以对输入信号进行一次转换的过程中必须通过一些外加方法使之保持恒定。常用的有采样-保持电路,在大多数的情况里,通过使用一个电容器可以存储输入的模拟电压,并通过开关或门电路来闭合、断开这个电容和输入信号的连接。许多模拟数字转换集成电路在内部就已经包含了这样的采样-保持子系统。
1.仪表促进了更快的ADC速度和更多的通道数与密度,设计者必须评估转换器的输出格式,以及基本的转换性能 [2] 。
2.主要的输出选项是CMOS(互补金属氧化物半导体)、LVDS(低压差分信令),以及CML(电流模式逻辑) [2] 。
3.要考虑的问题包括:功耗、瞬变、数据与时钟的变形,以及对噪声的抑制能力 [2] 。
4.对于布局的考虑也是转换输出选择中的一个方面,尤其当采用LVDS技术时。 当设计者有多种ADC选择时,他们必须考虑采用哪种类型的数字数据输出:CMOS(互补金属氧化物半导体)、LVDS(低压差分信令),还是CML(电流模式逻辑)。ADC中所采用的每种数字输出类型都各有优缺点,设计者应结合自己的应用来考虑。这些因素取决于ADC的采样速率与分辨率、输出数据速率,以及系统设计的功率要求,等等